【摘 要】
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线程级推测(TLS)技术的有效运用可提高多核芯片的硬件资源利用率,其已在多种串行应用的自动并行化工作中取得了较好效果,但目前缺乏对HPEC应用子程序级线程推测方面的有效分
【机 构】
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西南科技大学计算机科学与技术学院,西南科技大学四川省军民融合研究院,四川省计算机研究院
【基金项目】
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国家自然科学基金(61672438),国家留学基金委项目(CSC201908510040),四川省科技计划项目(2019YJ0326),四川省教育厅研究项目(18ZB0603),西南科技大学科研项目(18lzx451,17lzx621),西南科技大学研究生创新基金(19ycx0051)
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线程级推测(TLS)技术的有效运用可提高多核芯片的硬件资源利用率,其已在多种串行应用的自动并行化工作中取得了较好效果,但目前缺乏对HPEC应用子程序级线程推测方面的有效分析。针对该问题,设计子程序级推测的剖析机制及核心数据结构,选取HPEC中7个具有代表性的程序,挖掘其子程序级的最大潜在并行性,并结合线程粒度、并行覆盖率、子程序调用次数、数据依赖及源码,对程序的加速比进行分析。实验结果表明,fdfir、svd、db和ga程序的加速比在2.23~11.31,tdfir程序的加速效果最好,加速比达到221.7
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