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针对星载伪码测距系统中伪码同步的实现问题,给出了一种适宜在FPGA中实现的结构。系统采用归一化超前减滞后功率鉴相器以及二阶环路滤波的架构,对非相干延迟锁定环路进行理论分析和仿真,并给出了FPGA中实现资源统计。仿真结果表明,该方法具有很高的伪码跟踪精度,满足星载伪码测距的要求。
星载伪码测距系统精确同步及FPGA实现
【摘 要】
：
针对星载伪码测距系统中伪码同步的实现问题,给出了一种适宜在FPGA中实现的结构。系统采用归一化超前减滞后功率鉴相器以及二阶环路滤波的架构,对非相干延迟锁定环路进行理论
【机 构】
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中国科学院电子学研究所
【出 处】
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信息技术
【发表日期】
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2015年1期
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