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设计了一个基于FPGA的单精度浮点数乘法器。设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构，并提出对Wallace树产生的2个伪和采用部分相加的方式，提高了乘法器的运算速度；加入对特殊值的处理模块，完善了乘法器的功能。本设计在AlteraDE2开发板上进行了验证。
基于FPGA的单精度浮点数乘法器设计
【摘 要】
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设计了一个基于FPGA的单精度浮点数乘法器。设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构，并提出对Wallace树产生的2个伪和采用部分相加的方式，提高了乘
【机 构】
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武汉大学物理科学与技术学院
【出 处】
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电子技术应用
【发表日期】
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2010年5期
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