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SDH信号中任意抽取时隙的识别方法及FPGA实现
SDH信号中任意抽取时隙的识别方法及FPGA实现
来源 :光通信技术 | 被引量 : 5次 | 上传用户:cqyxp
【摘 要】
:
提出了一种实时有效的对任意抽取时隙的识别方法,适用于SDH机制光纤网络。同时,还提出了2种在FPGA上的实现方案,对方案二进行了较详细的描述。最后用Altera公司提供的开发软件Quartus5.0下的信号采集工具SignalTap对方案二的实现进行了验证。
【作 者】
:
刘正春
刘纯武
黄芝平
【机 构】
:
国防科技大学机电工程与自动化学院
【出 处】
:
光通信技术
【发表日期】
:
2006年03期
【关键词】
:
SDH
时隙
FPGA
SDH
time slot
FPGA
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提出了一种实时有效的对任意抽取时隙的识别方法,适用于SDH机制光纤网络。同时,还提出了2种在FPGA上的实现方案,对方案二进行了较详细的描述。最后用Altera公司提供的开发软件Quartus5.0下的信号采集工具SignalTap对方案二的实现进行了验证。
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