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用VHDL语言描述的伪随机码发生器自动校验模型
对于仿真目标而言,描述一个系统的自校验模型是非常重要的,因为模型准确地描述了系统是确实必须的.本文给出了用VHDL语言描述的伪......
会议
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伪随机码发生器
修改的线性实时逻辑
自校验模型
系统
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仿真目标
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实时限制
传统逻辑
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评价
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测试
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