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折叠DMF相关论文
数字匹配滤波器的递归折叠实现
针对数字匹配滤波器(DMF)的FPGA实现提出一种优化结构.利用16位移位寄存器(SRL16E)的存储潜力。设计递归延迟线(RDL);再利用RDL抽头个数倍......
期刊
数字匹配滤波器
递归延迟线
折叠DMF
时分复用
digital matched filter
recursive delay line
folded DM
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