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sub-samplingPLL(SSPLL)相关论文
一款基于0.18μm CMOS工艺的5.2-5.7GHz低电压低噪声亚采样锁相环设计
本论文提出了一个低电压条件下工作在5.2-5.7 GHz的亚采样锁相环芯片设计.低电压亚采样锁相环的设计难点主要在于,在一定的工艺条......
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