【摘 要】
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本论文介绍了一种TPC码迭代译码器的硬件设计方案。基于软判决译码规则,采用完全并行的规整的译码结构,使用VHDL硬件描述语言,在XILINX公司的FPGA产品Sparten-Ⅱ系列的xc2s30
【机 构】
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西安通信学院,陕西,西安,710106
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本论文介绍了一种TPC码迭代译码器的硬件设计方案。基于软判决译码规则,采用完全并行的规整的译码结构,使用VHDL硬件描述语言,在XILINX公司的FPGA产品Sparten-Ⅱ系列的xc2s300上实现了码率为1/2的(8,4)两维乘积码迭代译码器,迭代次数为四次时最大译码速率可达到50Mbit/s.该译码器的功能仿真证明了这种方案的可行性和正确性。
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