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如何用VHDL设计符合实际的电路
如何用VHDL设计符合实际的电路
来源 :全国首届VHDL语言及其应用学术会议--第六届全国逻辑设计自动化学术会议 | 被引量 : 0次 | 上传用户:angelfang555
【摘 要】
:
用VHD设计是未来电路设计方法的趋势,如何将功能强大、结构复杂的VHDL与先进的EDA系统综合工具相结合是在用VHDL设计时要解决的问题,该文为作者使用VHDL设计电路的几点体会。
【作 者】
:
王进祥
【机 构】
:
滨工业大学313信箱
【出 处】
:
全国首届VHDL语言及其应用学术会议--第六届全国逻辑设计自动化学术会议
【发表日期】
:
1996年期
【关键词】
:
设计方法
系统综合
设计电路
结构复杂
计时
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用VHD设计是未来电路设计方法的趋势,如何将功能强大、结构复杂的VHDL与先进的EDA系统综合工具相结合是在用VHDL设计时要解决的问题,该文为作者使用VHDL设计电路的几点体会。
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