【摘 要】
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本论文介绍了兰州重离子加速器冷却储存环(HIRFL-CSR)外靶实验中时间起点探测器(T0)的前端电子学原型模块的设计与测试。本论文探索了基于过阈时间法(TOT)和专用集成电路
【机 构】
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核探测与核电子学国家重点实验室,中国科学技术大学,安徽合肥230026;近代物理系,中国科学技术大学,安徽合肥230026
【出 处】
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安徽省核学会理事扩大会暨2015年学术年会
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本论文介绍了兰州重离子加速器冷却储存环(HIRFL-CSR)外靶实验中时间起点探测器(T0)的前端电子学原型模块的设计与测试。本论文探索了基于过阈时间法(TOT)和专用集成电路(ASIC) NINO芯片进行多气隙电阻板室(MRPC)探测器信号读出的模拟前端电路的设计技术,并实际完成了原型电子学模块的设计。此模块共集成6测量通道,可以进行前沿甄别及电荷时间变换。目前已经在实验室条件下完成了各项电子学性能测试,包括不同甄别阈值下的时间精度测试以及不同输入信号幅度下的输出脉宽测试。测试结果表明,在100 fC至2pC的动态范围内,此模块时间精度好于20 ps,满足应用需求,这也为进一步的电子学系统设计做好了准备。
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