【摘 要】
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ＰＡＮＤＡ ＶＤＥ向设计师提供可交互和开放的ＶＨＤＬ设计开发框架环境，目前已经具备了前端的图文混合输入手段，编译器，仿真调试器。由于Ｖｅｒｉｌｏｇ－ＨＤＬ在门级和电路级上具有完善和强大的描述能力，在 ＥＤＡ业界得到了广泛应
【出 处】
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第七届全国数字系统设计自动化学术会议暨协同设计研讨会
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ＰＡＮＤＡ ＶＤＥ向设计师提供可交互和开放的ＶＨＤＬ设计开发框架环境，目前已经具备了前端的图文混合输入手段，编译器，仿真调试器。由于Ｖｅｒｉｌｏｇ－ＨＤＬ在门级和电路级上具有完善和强大的描述能力，在 ＥＤＡ业界得到了广泛应用。该文在分析ＶＨＤＬ编译器的基础上，提取两者相同的语言特性，设计和实现Ｖｅｒｉｌｏｇ－ＨＤＬ的编译器，使之集成到ＶＤＥ中，并且提供ＡＰＩ函数来访问编译结果，从而可以作为一个独立的模块与其他的ＥＤＡ工具集成。
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