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基于Cell-aware的高效测试及测试成本优化研究
【摘 要】
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集成电路工艺的不断发展及复杂单元如多路选择器和异或门在芯片设计中的使用,使得越来越多不可测的缺陷开始在复杂单元内甚至晶体管级发现,而复杂Fin FET三维结构的使用以及为加快So C设计过程的IP复用技术也给可测性测试提出了新的挑战。传统的基于静态故障的固定型故障模型和基于动态故障的传输故障模型仅仅考虑到库单元端口处和单元之间互连线上的缺陷,已渐渐无法满足IC客户愈加严苛的零缺陷要求。新型测试方法
【出 处】
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西安电子科技大学
【发表日期】
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2021年05期
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