【摘 要】
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该论文研究了100m快速以太网卡控制芯片体系结构.此芯片包括PCI接口模块、两个2KB的FIFO模块、发送DMA控制模块、接收DMA控制模块、介质访问控制(MAC)模块和10/100Mbit/s集成
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该论文研究了100m快速以太网卡控制芯片体系结构.此芯片包括PCI接口模块、两个2KB的FIFO模块、发送DMA控制模块、接收DMA控制模块、介质访问控制(MAC)模块和10/100Mbit/s集成物理层(PHY)模块.以太网卡控制芯片中的介质访问控制(MAC)模块主要负责发送和接收数据封包以及介质访问管理,是100M快速以太网卡控制芯片中的重要组成部分.电路的设计中采用同步设计技术,时序电路全部采用时钟上升沿触发,很好地符合了可测性设计的要求,并且有利于静态时序分析,有利于整个网卡控制芯片系统的验证和协同仿真,具有根强的可控性、可观测性和可重用性.论文在以大网卡控制器MAC模块的系统设计、实现技术上均有所创新,并在设计方法学上做了有益的探索和实践.
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