基于FPGA的级联编码研究及实现

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信道纠错编是一项保证通信数据可靠性的重要技术,在深空通讯、存储系统、电视广播系统等诸多领域中有着广泛应用。随着编码理论和信息技术的发展,单一的编码方式已经很难满足某些系统的要求,所以在实际应用中,常采用纠错能力更强的级联编码方式。本课题主要研究和实现了以RS码、卷积码为级联方式的级联编码系统并在系统中引入了交织技术。本文首先介绍了课题的研究背景、研究意义以及一些常用纠错码的发展现状,然后分析了几种常见的纠错码,根据不同纠错码的优缺点以及实际需要,讨论了RS码、交织码、卷积码参数的选取,并根据讨论制定出了级联编码方案,接着依次介绍了级联码内码、外码的编码和译码原理,然后给出了各模块的实现方法以及在FPGA上的仿真结果。本文对关键方程求解过程中用到的BM算法部分进行了优化,减少了运算量。卷积译码部分研究了VIterbi算法以及译码器各模块的实现并对部分模块进行了改进。最后,通过仿真验证了该级联方案的抗干扰能力,证明了设计的正确性和可行性。
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