CMOS PLL时钟发生器的设计与实现

来源 :哈尔滨工业大学 | 被引量 : 0次 | 上传用户:YINGWU2008
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锁相环时钟发生器以其低造价、高性能、易于集成的优点成为工业上设计的主流.该文的工作内容是CMOS锁相环时钟发生器的设计和实现.首先,该文介绍了锁相技术的由来、特性、发展和应用.锁相技术由来已早,锁相环路具有载波跟踪特性、调制跟踪特性及低门限特性,正是由于其独特的优良性能使其广泛应用于电子、通讯等各个领域.该文详细介绍了锁相环路的基本工作原理.其次,该文通过电路模拟以及Hspice仿真,利用UMC公司的2.5V0.25μm工艺模型,完成对锁相环时钟发生器六个关键部件--参考电流源、鉴频鉴相器、电荷泵、环路滤波器、压控振荡器和分频器的设计以及整个锁相环路的整体设计与分析.最后,该文利用全定制设计方法设计出差分结构的延迟内插式压控振荡器的锁相环时钟发生器.
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