【摘 要】
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本文完成了一个10比特1.8V电源电压100MHz采样频率的流水线模数转换器的设计和芯片实现，并取得了其主要性能的测试结果。该模数转换器采用改进的每级1.5位结构，有效缓解了传统
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本文完成了一个10比特1.8V电源电压100MHz采样频率的流水线模数转换器的设计和芯片实现，并取得了其主要性能的测试结果。该模数转换器采用改进的每级1.5位结构，有效缓解了传统结构因为最后一级的量化电平失调造成的性能下降问题。电路子模块的设计具有如下的特点：高增益、高带宽的运算放大器与改进的栅压自举(bootstrap)采样开关的结合大大提高了采样保持电路的精度和线性度；回踢噪声(kickbacknoise)很小的动态比较器使模数转换器在高速采样时钟下能保持各级输出的模拟信号的稳定；优化的双相非交叠时钟产生电路提高了时钟周期的利用率。
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