【摘 要】
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结合工程应用中对快速傅里叶变换(FFT)的要求,研究了采用专用集成电路(ASIC)和现场可编程门阵列(FPGA)实现FFT的方案,同时对雷达信号处理中恒虚警率(CFAR)检测器的脉动结构进
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结合工程应用中对快速傅里叶变换(FFT)的要求,研究了采用专用集成电路(ASIC)和现场可编程门阵列(FPGA)实现FFT的方案,同时对雷达信号处理中恒虚警率(CFAR)检测器的脉动结构进行了研究.主要完成了以下工作:①回顾了各种FFT算法,对其是否适于用VLSI实现进行了研究.在此基础上,选择了递归结构的基4FFT算法进行了ASIC设计.其中分析了硬件实现中的误差,导出了适于硬件实现的旋转因子的表达式,给出了相应的控制单元和运算单元的结构,并针对雷达信号处理的特点,提出了每级蝶形运算只扩展两位的块浮点运算方案;②针对特定的应用背景,深入讨论了FPGA的集成规模与FFT算法选择间的关系,提出了用FPGA实现FFT的方案并经严格的实验验证,同时提出了改进的截断乘法器,以减小乘法器的占用面积;③研究了有序统计(OS)和剔除平均(TM)两种CFAR检测器的脉动结构,提出了一种新的TM检测器的脉动结构,并提出了将FFT、平方律检波和CFAR检测集成在单个芯片内的设计思想.
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