RISC-V精简指令架构的研究及基于RV32I指令集的处理器内核设计

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目前,通用处理器架构主要以X86架构和ARM架构为主,X86架构的处理器具有超高的时钟主频、强大的计算能力,广泛用于服务器和个人电脑,而ARM架构处理器兼顾高主频外还考虑低功耗性能,其产品主要应用于手机终端和嵌入式设备。近年来,人工智能、物联网、边缘计算等技术开始显现出巨大的应用前景,但对处理器的低成本、低功耗、定制化等方面提出了更高的要求。相比较前两种架构,RISC-V架构的指令集更加精简,指令集模块化且开源,这些优势特别是开源带来的低成本优势,能够极大地满足这些需求。RISC-V架构的出现受到许多初创公司的追捧,但也存在不足。首先,RISC-V已经有许多商业应用,但由于知识产权问题,目前,大部分开发依然被严格保密。其次,大部分商用项目不允许在其成果上进行修改和扩展,例如增加流水线级数和采用多核技术。基于上述原因,本文基于RISC-V RV32I指令集设计出了32位顺序执行的单周期处理器和五级流水线处理器。本文具体研究内容包括:(1)研究RV32I指令集和处理器微架构相关理论知识,设计了带8K字节紧耦合存储器的单周期处理器;(2)在单周期处理器设计基础上,研究流水线技术,设计了五级流水线处理器;(3)为该处理器设计了总线接口和定义一种新的接口协议,实现了处理器内核访问外设和外设访问处理器的紧耦合存储器的功能。整个设计采用Verilog行为级建模、RTL级描述,最后在Xilinx AX7A035开发板上完成FPGA原型验证。验证结果表明,设计的单周期处理器能够支持RV32I指令集的28条基本指令,其时钟频率为25MHz,单周期处理器内核功耗为1m W,包含紧耦合存储器和总线接口的单周期处理器功耗为2m W,共占用LUT单元819个,寄存器1024个,多路选择器228个。
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