用于SDH 2Mb/s支路输出的一种全数字锁相环设计与实现

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户:a1402070128
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文章提出了一种二阶全数字锁相环的实现方法,由于采用鉴频、鉴相并置方法,同时把数字滤波器融入其中,采用小数分频器构成数控振荡器,从 TU- 12中恢复 E1时钟信号。经硬件实验证实,电路的性能指标完全可以满足 ITU- T的有关标准。采用全数字锁相环对系统集成有明显的好处。 This paper presents a realization of a second-order all-digital phase-locked loop. Because of adopting the method of frequency discrimination and phase discrimination and combining the digital filter into it, a digital controlled oscillator is constructed by the fractional frequency divider. From TU-12 Restore the E1 clock signal. The hardware experiments show that the performance of the circuit can meet the ITU-T standards. The use of all-digital phase-locked loop system has obvious benefits for system integration.
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