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微处理器体系结构仿真已成为微处理器设计空间探索(DSE)和系统设计方案优化的主要手段。通过对LS RISC微处理器体系结构建模研究,分析国内外先进的仿真技术,设计并实现了LS RISC的解释型指令集仿真器LR-sim。LR-sim主要由解码器、流水线系统、指令调度机、时钟驱动模块、资源管理器和层次存储系统组成,在进行细粒度时钟级建模的同时兼顾了仿真效率。经过大量数据测试,此仿真器有利于优化硬件布局布线,缩短硬件设计周期,具有较强的可移植性、可操作性和可扩展性。