静态时序分析在深亚微米ASIC设计中的应用

来源 :计算机与数字工程 | 被引量 : 0次 | 上传用户：xoyo20001

【摘要】

：

作为分析和验证电路时序行为的新手段,静态时序分析(STA)技术以其无需仿真、快速、占用内存少以及测试覆盖面全等优点越来越多的应用于现代深亚微来ASIC设计中.本文在介绍了S

【作者】

：

吴丹刘三清邹雪城徐维锋

【机构】

：

华中科技大学电子科学与技术系,华中科技大学电子科学与技术系,武汉亚芯微电子有限公司

【出处】

：

计算机与数字工程

【发表日期】

：

2004年2期

【关键词】

：

深亚微米静态时序分析时序约束

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作为分析和验证电路时序行为的新手段,静态时序分析(STA)技术以其无需仿真、快速、占用内存少以及测试覆盖面全等优点越来越多的应用于现代深亚微来ASIC设计中.本文在介绍了STA基本概念的基础上,以SDH系统中8/16/32路E1映射(E1 mapper)芯片设计为例,对STA在设计中的具体应用及注意事项进行了详细说明.结果表明,我们所采用的STA技术在设计的各阶段均很好的满足了电路的时序要求.

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