【摘 要】
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针对SoC中同步TP RAM的功耗较大问题,提出一种设计方法。通过将SoC中的同步TP RAM替换成SP RAM,在SP RAM外围增加读写接口转换逻辑,使替换后的RAM实现原TP RAM的功能,保持对
【机 构】
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西安高新唐南中学,西安培华学院中兴电信学院
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针对SoC中同步TP RAM的功耗较大问题,提出一种设计方法。通过将SoC中的同步TP RAM替换成SP RAM,在SP RAM外围增加读写接口转换逻辑,使替换后的RAM实现原TP RAM的功能,保持对外接口不变。为了进一步降低功耗,对地址总线进行格雷编码,采用动态电压调整技术及合理的电源分区策略。将文中方法应用于一款多核SoC芯片,经TSMC 28 nm HPC工艺实现。仿真结果表明:优化后的RAM面积减少了24.76%,功耗降低了44.89%。
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