【摘 要】
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为降低芯片功耗,提升性能,从系统级、结构级和RTL级3个层次提出了一种片上系统（System on Chip,SoC）芯片的低功耗设计方法,并在样片中得以验证。在系统级层面,根据SoC芯片的不
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为降低芯片功耗,提升性能,从系统级、结构级和RTL级3个层次提出了一种片上系统（System on Chip,SoC）芯片的低功耗设计方法,并在样片中得以验证。在系统级层面,根据SoC芯片的不同工作场合,在正常运行模式的基础之上,设计了睡眠、停止和待机3种低功耗模式。在结构级层面,将整个芯片划分为VDD、VDDA和VBAT3个电压域,以降低系统功耗。在RTL级,针对不同的模式切换,设计了时钟管理技术,实现了对不同模式下不同时钟的控制。仿真和实验结果证明了设计的合理性,实测数据表明,睡眠模式最多降低59.1
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