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本文介绍了一种针对高性能多核数字信号处理器内核的验证系统。根据指令集规则构建了基于记分板的随机激励产生系统，并结合软件仿真环境、各功能节点观测单元搭建了全内核功能验证系统。结论部分通过演示范例证明了该系统的功能正确性，并基于实际验证中的工作情况介绍了基于该系统的实际查错流程。
高性能多核数字信号处理器内核验证系统设计
【摘 要】
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本文介绍了一种针对高性能多核数字信号处理器内核的验证系统。根据指令集规则构建了基于记分板的随机激励产生系统，并结合软件仿真环境、各功能节点观测单元搭建了全内核功能
【机 构】
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中国电子科技集团公司第三十八研究所
【出 处】
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中国集成电路
【发表日期】
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2015年4期
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