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根据AVS音视频编码标准中提出的环路滤波算法设计了一个高效的环路滤波器。通过适当地增加片上数据存储空间，使得整个环路滤波的过程占用的带宽资源最小。该滤波器经过仿真验证，对一个完整的4：2：0格式的宏块数据进行环路滤波仅需293个时钟周期。可以被用于1920×1080高清图像的AVS解码芯片中。
基于FPGA的AVS环路滤波器设计与实现
【摘 要】
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根据AVS音视频编码标准中提出的环路滤波算法设计了一个高效的环路滤波器。通过适当地增加片上数据存储空间，使得整个环路滤波的过程占用的带宽资源最小。该滤波器经过仿真验
【机 构】
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上海交通大学芯片与系统研究中心
【出 处】
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计算机工程
【发表日期】
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2007年6期
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