【摘 要】
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用标准计数器设计4位数字频率计使用器件多，电路复杂，CPLD（复杂可编程逻辑器件）和EDA（电子设计自动化）技术已经代替传统的设计方法，逐渐成为电子系统设计者的主要设计手段。文中采用
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用标准计数器设计4位数字频率计使用器件多，电路复杂，CPLD（复杂可编程逻辑器件）和EDA（电子设计自动化）技术已经代替传统的设计方法，逐渐成为电子系统设计者的主要设计手段。文中采用自顶向下的方法在一片CPLD芯片上实现4位简易数字频率计。详细给出了CPLD内部基于MAX＋PLUSⅡ开发软件，利用VHDL硬件描述语言和原理图的输入方式来实现电路的具体过程，以及外围被测信号限幅整形电路和时基信号产生电路原理图，电路简单且便于修改，经实际电路测试，该系统性能稳定，EDA技术使数字系统的设计进入一个更新、更快的
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