一种高性能CMOS采样／保持电路

来源 :微电子学 | 被引量 : 0次 | 上传用户：chezhenmen

【摘要】

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介绍了一种高性能CMOS采样/保持电路.该电路在3 V电源电压下,60 MHz采样频率时,输入直到奈奎斯特频率仍能够达到90 dB的最大信号谐波比(SFDR)和80 dB的信噪比(SNR).电路采用

【作者】

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罗阳杨华中

【机构】

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清华大学电子工程系电路与系统教研室

【出处】

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微电子学

【发表日期】

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2005年6期

【关键词】

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CMOS 采样/保持电路开关栅电压自举增益自举运算放大器 CMOS Sample/hold circuit Bootstrap Gain-booster o

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介绍了一种高性能CMOS采样/保持电路.该电路在3 V电源电压下,60 MHz采样频率时,输入直到奈奎斯特频率仍能够达到90 dB的最大信号谐波比(SFDR)和80 dB的信噪比(SNR).电路采用全差分结构、底板采样、开关栅电压自举(bootstrap)和高性能的增益自举运算放大器.采用0.18 μm CMOS工艺库,对电路进行了Hspice仿真验证.结果表明,整个电路消耗静态电流5.8 mA.

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