一种8点FFT算法的逻辑电路实现

来源 :微电子学与计算机 | 被引量 : 0次 | 上传用户：fy9112003

【摘要】

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文章讲述了一种8点FFT的verilog HDL设计实现,着重阐述了有符号的复数加/减法器的设计,并给出了整个系统仿真的结果,该设计可以在4个时钟内计算一个数据.最后该系统在Altera

【作者】

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孙飞周宁孙亚楠郑南宁

【机构】

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西安交通大学人工智能与机器人研究所

【出处】

：

微电子学与计算机

【发表日期】

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2002年11期

【关键词】

：

8点FFT算法逻辑电路硬件描述语言离散傅里叶变换数字信号处理 FFT Verilog HDL

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文章讲述了一种8点FFT的verilog HDL设计实现,着重阐述了有符号的复数加/减法器的设计,并给出了整个系统仿真的结果,该设计可以在4个时钟内计算一个数据.最后该系统在Altera公司的FLEX10K的FPGA上成功地实现了综合,实验结果证明这种设计方法不但具有设计方法简单的优点,而且吞吐量可以达到2M/s的变换速度,已经完全能够满足目前一些系统的要求(如OFDM系统).

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