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本文针对IPv6网络协处理器中应用普遍的IPv6解析器，提出一种解析器的硬件实现方法，分析了各个模块的功能和实现方式。并用硬件描述语言verilog搭建HDL模型，进行了仿真和逻辑综合。同时使用相关的EDA工具加以验证。
基于硬件描述语言的IPv6报文解析器设计
【摘 要】
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本文针对IPv6网络协处理器中应用普遍的IPv6解析器，提出一种解析器的硬件实现方法，分析了各个模块的功能和实现方式。并用硬件描述语言verilog搭建HDL模型，进行了仿真和逻辑综合
【机 构】
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电子科技大学光电信息学院
【出 处】
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计算机光盘软件与应用
【发表日期】
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2011年16期
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