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针对在数字下变频系统中单独应用CIC滤波器实现抽取滤波时,因高阶CIC滤波器通带衰减过大的问题,在原有的CIC滤波器后级联一补偿滤波器以达到降低采样率,防止频率混叠的目的。仿真结果表明,改进后的CIC滤波器通带波纹数减少,通带衰减降幅明显。
基于FPGA的CIC滤波器的优化设计
【摘 要】
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针对在数字下变频系统中单独应用CIC滤波器实现抽取滤波时,因高阶CIC滤波器通带衰减过大的问题,在原有的CIC滤波器后级联一补偿滤波器以达到降低采样率,防止频率混叠的目的。
【机 构】
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西华师范大学电子信息工程学院
【出 处】
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西华师范大学学报(自然科学版)
【发表日期】
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2017年1期
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