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增强型并行端口EPP扩展移位寄存器输出接口的方法
增强型并行端口EPP扩展移位寄存器输出接口的方法
来源 :电子工程师 | 被引量 : 0次 | 上传用户:dygaalove4390
【摘 要】
:
基于EPP协议的特点,应用复杂可编程逻辑器件(CPLD)开发了移位寄存器输出接口.介绍了EPP协议和接口的Verilog HDL描述.
【作 者】
:
劳奇成
李涤尘
卢秉恒
【机 构】
:
西安交通大学机械工程学院
【出 处】
:
电子工程师
【发表日期】
:
2002年5期
【关键词】
:
增强型并行端口
EPP
移位寄存器输出
CPLD
VERILOG
HDL
接口
ISA
总线
计算机
Enhanced Parallel Port (EPP)
【基金项目】
:
国家高技术研究发展计划(863计划)
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基于EPP协议的特点,应用复杂可编程逻辑器件(CPLD)开发了移位寄存器输出接口.介绍了EPP协议和接口的Verilog HDL描述.
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