【摘 要】
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设计了一款基于0.18μmCMOS工艺带失调校准的高速高精度两级采样保持电路。该电路选择开环双通道时间交织的采样保持架构,提高了整体采样保持电路的速率。通过采用高精度失调
【基金项目】
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中央高校基本科研业务费专项资金项目(JD2016JGPY0003).
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设计了一款基于0.18μmCMOS工艺带失调校准的高速高精度两级采样保持电路。该电路选择开环双通道时间交织的采样保持架构,提高了整体采样保持电路的速率。通过采用高精度失调校准电路、改进的级间缓冲器以及栅压自举开关等来提高采样保持电路的精度。电路仿真结果表明,在电源电压为2V,采样时钟为1.6GHz,输入信号频率为382.8MHz,第一级和第二级保持电容分别为0.9fF和0.6fF时,该电路的无杂散动态范围(SFDR)为85.8dB,总谐波失真(THD)为-81.7dB,有效位数(ENOB)为12.6Bit
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