【摘 要】
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设计了一种基于PIC单片机和CPLD（复杂可编程逻辑器件）共同控制、FLASH MEMORY（闪速大容量存储器）存储的新型存储测试系统。设计方案实现了在采样速率变化的情况下,FIFO自适应地完
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设计了一种基于PIC单片机和CPLD（复杂可编程逻辑器件）共同控制、FLASH MEMORY（闪速大容量存储器）存储的新型存储测试系统。设计方案实现了在采样速率变化的情况下,FIFO自适应地完成缓存速率调整的功能,并且多通道数据能连续不间断地存储到FLASH存储器中。采用了一种新的对FLASH无效块检测的方法,延长了系统的使用时间。实验结果表明,电路能够准确有效地进行A/D数据采集。
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