万兆级别以太网编解码芯片设计

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研究了万兆级别以太网编解码芯片的设计方法,在前端设计中给出了编解码电路的结构图,并对电路进行仿真,得到解码和扰码的仿真波形图;同时给出了后端芯片设计版图结果;最后提出了流片后可行性的测试方案。
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