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期刊论文
万兆级别以太网编解码芯片设计
万兆级别以太网编解码芯片设计
来源 :工业控制计算机 | 被引量 : 0次 | 上传用户:filltang
【摘 要】
:
研究了万兆级别以太网编解码芯片的设计方法,在前端设计中给出了编解码电路的结构图,并对电路进行仿真,得到解码和扰码的仿真波形图;同时给出了后端芯片设计版图结果;最后提
【作 者】
:
卢彦民
【机 构】
:
南京模拟技术研究所
【出 处】
:
工业控制计算机
【发表日期】
:
2019年11期
【关键词】
:
万兆级别
编解码
芯片
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研究了万兆级别以太网编解码芯片的设计方法,在前端设计中给出了编解码电路的结构图,并对电路进行仿真,得到解码和扰码的仿真波形图;同时给出了后端芯片设计版图结果;最后提出了流片后可行性的测试方案。
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