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为了缩短卷积编码器设计周期，使硬件设计更具灵活性，在介绍卷积编码器原理的基础上，论述了一种基于可编程逻辑器件，采用模块化设计方法，利用VHDL硬件描述语言实现CDMA2000系统前向链路卷积编码器的方法，给出了在QuartusⅡ软件下的仿真结果，并在FPGA器件上验证实现。仿真和实验都证明了这种方法的可行性和正确性。