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本文给出一种利用DDR3高速存储芯片完成雷达数据重排的方法,详细描述了基于赛灵思FPGA的DDR3接口控制逻辑设计,并应用于工程实际提高了雷达信号处理的存储能力,满足新体制雷达大批量数据处理需求。
基于DDR3的数据重排设计
【摘 要】
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本文给出一种利用DDR3高速存储芯片完成雷达数据重排的方法,详细描述了基于赛灵思FPGA的DDR3接口控制逻辑设计,并应用于工程实际提高了雷达信号处理的存储能力,满足新体制雷
【机 构】
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西安电子工程研究所
【出 处】
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火控雷达技术
【发表日期】
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2013年02期
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