CPT铷原子钟锁相环频率合成器设计和分析

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【摘要】

：

基于CPT(相干布局囚禁)87铷原子钟设计出输出频率为3417 MHz的锁相环频率合成器,通过ADIsimPLL仿真出最佳环路带宽,环路滤波器参数以及相位噪声等,并通过STM32对锁相环芯片进

【作者】

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牟仕浩张开放苏浩张璐刘召军张彦军闫树斌

【机构】

：

中北大学仪器科学与动态测试教育部重点实验室

【出处】

：

电子器件

【发表日期】

：

2020年1期

【关键词】

：

频率合成器原子钟锁相环 ADIsimPLL 相位噪声 frequency synthesizeratomic clockPLLADIsimPLLphase

【基金项目】

：

科技部国家重点研发计划项目(2017YFB0503200),山西省自然基金项目(201701D121065),国家高分辨率对地观测系统重大专项项目(67-Y20A07-9002-16/17),山西省“1311工程”重点学科建设计划项目,山西省高等学校131领军人才项目,山西省高等学校中青年拔尖创新人才项目,山西省留学回国人员科技活动择优项目

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基于CPT(相干布局囚禁)87铷原子钟设计出输出频率为3417 MHz的锁相环频率合成器,通过ADIsimPLL仿真出最佳环路带宽,环路滤波器参数以及相位噪声等,并通过STM32对锁相环芯片进行控制。对频率合成器进行了测试,电路尺寸为40 mm×40 mm,输出信号功率范围为-4 dBm~+5 dBm可调,输出信号噪声满足要求-88.65 dBc/Hz@1 kHz,-92.31 dBc/Hz@10 kHz,-104.63 dBc/Hz@100 kHz,杂散和谐波得到抑制,设计的频率合成器能很好的

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