【摘 要】
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文章介绍了基于FPGA的流水线RISC微处理器的设计,包括关键模块设计和流水线设计。所设计的微处理器主要由ALU,译码单元,取指逻辑,寄存器堆,指令存储器,数据存储器等关键模块
【基金项目】
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国家人事部留学人员科技活动基金：基于异步式逻辑的FPGAIP核的研究（[2006]164）,广东省科技计划基金：基于异步式逻辑的高性能、低能耗的ARMIP核研究（2006811801010）,广东省自然科学基金：基于入侵检测系统中的智能化无主次通讯机制研究（04107411）
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文章介绍了基于FPGA的流水线RISC微处理器的设计,包括关键模块设计和流水线设计。所设计的微处理器主要由ALU,译码单元,取指逻辑,寄存器堆,指令存储器,数据存储器等关键模块组成,其指令和数据长度都为32位,采用三种寻址方式。通过对关键模块的时序分析,设计合理的流水线。文章着重分析了因流水线产生的相关性问题,并采用旁路技术（Forwarding）和硬件＂猜测法＂加以解决。综合和功能仿真结果表明该RISC处理器达到了设计要求,其最高时钟频率达到74.59MHz。
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