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基于通信系统编解码芯片的逻辑综合研究
基于通信系统编解码芯片的逻辑综合研究
来源 :现代导航 | 被引量 : 0次 | 上传用户:caifubaguoguo
【摘 要】
:
未来大批量、小型化、低功耗设备对专用处理芯片的需求迫切,本文针对通信系统编解码芯片复杂的时钟、复位、IO设计,分别采用多生成时钟、内部复位、虚拟时钟的设置,有效的实
【作 者】
:
舒钰
【机 构】
:
中国电子科技集团公司第二十研究所
【出 处】
:
现代导航
【发表日期】
:
2017年1期
【关键词】
:
逻辑综合
时序约束
生成时钟
Logic Synthesis Timing Constraint Generated Clock
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未来大批量、小型化、低功耗设备对专用处理芯片的需求迫切,本文针对通信系统编解码芯片复杂的时钟、复位、IO设计,分别采用多生成时钟、内部复位、虚拟时钟的设置,有效的实现芯片时序的收敛,达到了较好的综合结果.
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