【摘 要】
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随着工艺尺寸的减小,数字逻辑电路的漏电流成为当前FPGA面临的主要挑战。静态功耗增大的主要原因是各种漏电流源的增加。图1所示为随着更小逻辑门长度的技术实现,这些漏电流
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随着工艺尺寸的减小,数字逻辑电路的漏电流成为当前FPGA面临的主要挑战。静态功耗增大的主要原因是各种漏电流源的增加。图1所示为随着更小逻辑门长度的技术实现,这些漏电流源是怎样随之增加的。此外,如果不采取专门的功耗措施,较大的逻辑电容和较高的开关频率也会导致动态功耗增大。
As the process size decreases, the leakage current of digital logic becomes the major challenge currently facing FPGAs. The main reason for the increase of static power is the increase of various leakage current sources. Figure 1 shows how these leakage current sources increase with the implementation of smaller logic gate lengths. In addition, larger dynamic capacitance and higher switching frequency can result in increased dynamic power dissipation without dedicated power dissipation measures.
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