具有SDRAM容错和检错功能的PowerPC 高性能处理单元设计

来源 :航天控制 | 被引量 : 0次 | 上传用户：scamponline

【摘要】

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介绍一款PowerPC架构的高性能嵌入式处理单元设计.利用PowerPC体系结构内建的差错检测和报告机制,采用CPLD设计和实现了三模冗余(TMR)SDRAM存储器模块,不但提供高速存储器的

【出处】

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航天控制

【发表日期】

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2004年期

【关键词】

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PowerPC 嵌入式计算机 SDRAM 容错检错

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介绍一款PowerPC架构的高性能嵌入式处理单元设计.利用PowerPC体系结构内建的差错检测和报告机制,采用CPLD设计和实现了三模冗余(TMR)SDRAM存储器模块,不但提供高速存储器的容错能力,还具有差错检测能力,提高了处理单元的可靠性.介绍一个分布式容错计算机的实例,并分析了该方案的优点.

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