【摘 要】
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设计了一种逐次逼近寄存器型模数转换器(SAR ADC).提出了一种新型全动态钟控比较器结构,消除了比较器的亚稳态误差,解决了ADC输出不稳定的问题,实现了失调和噪声之间良好的折
【机 构】
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江苏信息职业技术学院微电子学院,江苏无锡 214153;西安电子科技大学微电子学院,西安 710071
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设计了一种逐次逼近寄存器型模数转换器(SAR ADC).提出了一种新型全动态钟控比较器结构,消除了比较器的亚稳态误差,解决了ADC输出不稳定的问题,实现了失调和噪声之间良好的折中,提升了ADC的动态性能;设计了一种全新的自举开关,在确保采样保持电路性能的同时提高了其可靠性;提出了一种新颖的正反馈结构的动态逻辑单元,并应用在逐次逼近逻辑电路中,在降低功耗的同时消除了误码问题;改进了共模电平产生电路结构,提高了共模电平的产生速度和稳定性.电路采用0.18 μm DB S-BCD工艺设计实现,芯片面积约为360μm×560 μm,10 bit分辨率模式下的功耗和信噪失真比(SNRD)分别为21.1 μW和58.64 dB.
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