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提出了一种基于有限域内移位三项式基及其弱共轭基的比特并行乘法器的新结构。在由三项式生成的域内,此种结构的比特并行乘法器易于设计者使用硬件描述语言实现。采用Encounter软件对该结构进行布局布线后,发现其面积与关键路径时延都达到了设计目标的要求,在设计性能和硬件约束条件上取得了比较好的平衡。
一类有限域乘法器的设计实现
【摘 要】
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提出了一种基于有限域内移位三项式基及其弱共轭基的比特并行乘法器的新结构。在由三项式生成的域内,此种结构的比特并行乘法器易于设计者使用硬件描述语言实现。采用Encount
【机 构】
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浙江大学超大规模集成电路设计研究所
【出 处】
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电子器件
【发表日期】
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2008年6期
【基金项目】
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国家高技术研究发展计划（863计划）资助项目（2005AAIZ1260）,浙江省科技计划资助项目（2004C11043）
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