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在一片速度较低的FPGA芯片上，设计实现了综合型高速雷达数字信号发生器，给出了仿真结果，最高仿真数据事可迭2．44Gbps。介绍了综合型高速数字信号发生器的基本设计思路和几个实现技巧。重点介绍了在不改变芯片选择的情、况下，如何通过改进设计方案，提高系统的工作速度。
高速雷达数字信号发生器的FPGA设计与实现技巧
【摘 要】
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在一片速度较低的FPGA芯片上，设计实现了综合型高速雷达数字信号发生器，给出了仿真结果，最高仿真数据事可迭2．44Gbps。介绍了综合型高速数字信号发生器的基本设计思路和几个实现
【机 构】
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北京中国科学院电子学研究所
【出 处】
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微计算机信息
【发表日期】
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2006年03Z期
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