【摘 要】
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以东芝公司生产的TCD132D型号线阵CCD为例,介绍了一种基于CPLD和Verilog HDL语言的CCD时序驱动电路的设计方法。给出了Verilog HDL语言源代码,采用Modelsim SE等软件实现了功
【机 构】
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北京理工大学信息科技学院,北京大学,
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以东芝公司生产的TCD132D型号线阵CCD为例,介绍了一种基于CPLD和Verilog HDL语言的CCD时序驱动电路的设计方法。给出了Verilog HDL语言源代码,采用Modelsim SE等软件实现了功能、时序仿真。实验结果表明,设计符合实际工作需要。
Taking Toshiba TCD132D linear CCD as an example, a design method of CCD timing driving circuit based on CPLD and Verilog HDL language is introduced. Given the Verilog HDL language source code, using Modelsim SE and other software to achieve the function, timing simulation. The experimental results show that the design meets the needs of practical work.
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