【摘 要】
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基于FPGA实现加解密系统时,采用多种算法处理数据可以适应不同的应用环境与功能需求,但在同一片上实现多种算法会导致逻辑资源消耗增加、资源利用率低、系统灵活性差。针对以
【机 构】
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哈尔滨工业大学(威海)信息与电气工程学院,哈尔滨工业大学(威海)计算机科学与技术学院
【基金项目】
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山东省自然科学基金项目(ZR2014FM026、2015FM027),国家自然科学基金项目(61671174),航天支撑技术基金项目(2017-HT-HG-16),国家信息保障技术重点实验室开放基金项目(KJ-17-004).
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基于FPGA实现加解密系统时,采用多种算法处理数据可以适应不同的应用环境与功能需求,但在同一片上实现多种算法会导致逻辑资源消耗增加、资源利用率低、系统灵活性差。针对以上问题,以动态可重构技术为核心,基于ZYNQ-7000系列FPGA设计动态可重构控制平台,通过片上Cortex-A9 ARM处理器控制重配置处理模块,将存储于SD卡中的多种算法逻辑按功能需求配置到片上划定的逻辑分区中,更新逻辑电路并完成算法重构。实验结果表明,该设计能在片上其它功能正常工作的同时,以15759.51Bytes/ms的配置速度完
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