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静态时序工具在DDR Memory妾口时序收敛和后仿真中的应用
静态时序工具在DDR Memory妾口时序收敛和后仿真中的应用
来源 :集成电路应用 | 被引量 : 0次 | 上传用户:cklingdian
【摘 要】
:
为提高带宽,很多类型的Memory都采用了Double Data Rate(DDR)interface,它对在内存控制器(memory controller)设计过程中的时序收敛和后仿真提出了挑战.探讨利用静态时序分析
【作 者】
:
陈杰
刘勇
【机 构】
:
上海兆芯集成电路有限公司,上海,201203
【出 处】
:
集成电路应用
【发表日期】
:
2019年8期
【关键词】
:
集成电路设计
内存控制器
时序收敛
SDF后仿真
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为提高带宽,很多类型的Memory都采用了Double Data Rate(DDR)interface,它对在内存控制器(memory controller)设计过程中的时序收敛和后仿真提出了挑战.探讨利用静态时序分析工具解决这个问题的方法.
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