An Asynchronous 32×8-Bit Multiplier Based on LDCVSPG Logic

来源 :武汉大学学报:自然科学英文版 | 被引量 : 0次 | 上传用户:beibei114
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异步的高速度的 pipelined 32xg 位的数组更多样地,基于有通行证门(LDCVSPG ) 的拴住的微分 cascode 电压开关,逻辑被介绍。Themultiplier 基于 4 阶段双栏杆的协议。生产公司的中央半导体的 HSPICE 分析使用设备参数(CSMC 的) 0.6 妈妈互补金属氧化物半导体技术也被给,并且结果证明平均数据产量更多样地是 375 MHz。
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