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文中提出了一种新颍的SOC芯片BIST方案。该方案是利用相容技术和折叠技术，将SOC芯片中多个芯核的测试数据整体优化压缩和生成，并且能够实现多个芯核的并行测试，具有很高的压缩率，平均压缩率在94％以上；且结构简单、解压方便、硬件开销低，实验证明是一种非常好的SOC芯片的BIST方案。
一种多核共享测试数据的BIST方案
【摘 要】
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文中提出了一种新颍的SOC芯片BIST方案。该方案是利用相容技术和折叠技术，将SOC芯片中多个芯核的测试数据整体优化压缩和生成，并且能够实现多个芯核的并行测试，具有很高的压缩率
【机 构】
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安徽经济管理学院计算机系,合肥工业大学计算机与信息学院
【出 处】
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计算机技术与发展
【发表日期】
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2006年5期
【基金项目】
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国家自然科学基金资助项目（#90407008）,教育部留学回国人员科研基金资助项目（#2004.527）,安徽省自然科学基金资助项目（#050420103）
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