【摘 要】
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设计了一种单片集成的CMOS串行数据收发器．该收发器用于线上速率为1．25Gb／s的干兆以太网中．全集成了发送和接收的功能，主要由时钟发生器、时钟数据恢复电路、并串／串并转换电路、线
【机 构】
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复旦大学微电子学系．上海200433
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设计了一种单片集成的CMOS串行数据收发器．该收发器用于线上速率为1．25Gb／s的干兆以太网中．全集成了发送和接收的功能，主要由时钟发生器、时钟数据恢复电路、并串／串并转换电路、线驱动器和均衡器组成．为了降低系统设计难度和电路功耗，收发器采用了半速率时钟结构．电路采用1．8V0．18μm 1P6M CMOS数字工艺．芯片面积为2.0mm×1．9mm．经Cadence Spectre仿真验证以及流片测试，电路工作正常．功能良好．
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